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數字電路設計與驗證快速入門：Verilog+SystemVerilog（簡體書）
商品資訊
系列名：計算機技術開發與應用叢書
ISBN13：9787302635079
出版社：清華大學出版社(大陸)
作者：馬驍
出版日：2023/10/01
裝訂／頁數：平裝／378頁
規格：24cm*17cm (高/寬)
版次：一版
商品簡介
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商品簡介
本書系統講解數字電路、Verilog及SystemVerilog。數字電路基礎部分包括基本的門電路、數制碼制、組合邏輯和時序邏輯電路，以及對應的實例分析。Verilog基礎部分包括基礎語法，以及對應的實例分析。SystemVerilog基礎部分包括基礎語法，以及對應的實例分析。內容根據實際工程項目的經驗，做了精簡和重難點分析，並提供一些實際的案例供參考。
本書提供基礎語法的同時提供可以練手的案例和源代碼，並且通過實例講解，將設計和驗證的概念傳連在了一起，使得讀者學習起來更加有針對性，更有效率。市面上缺乏對於SystemVerilog這種兼顧設計和驗證語法的教材，本書旨在引導廣大讀者更輕鬆更容易且更貼近實際工程項目地學習相關語法知識，並教給讀者如何去應用。
本書適合相關專業的大學生，以及相關領域的技術工程人員閱讀。
本書提供基礎語法的同時提供可以練手的案例和源代碼，並且通過實例講解，將設計和驗證的概念傳連在了一起，使得讀者學習起來更加有針對性，更有效率。市面上缺乏對於SystemVerilog這種兼顧設計和驗證語法的教材，本書旨在引導廣大讀者更輕鬆更容易且更貼近實際工程項目地學習相關語法知識，並教給讀者如何去應用。
本書適合相關專業的大學生，以及相關領域的技術工程人員閱讀。
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